Cirrus-logic CS8416 Manuale Utente Pagina 55

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DS578F3 55
CS8416
18.2.5 Jitter Attenuation
Shown in Figure 25 is the jitter attenuation plot. The AES3 and IEC60958-4 specifications state a maxi-
mum of 2 dB jitter gain or peaking.
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J itte r F re que ncy (H z )
externa l J itte r Attenuation ( dB )
Figure 25. Jitter Attenuation Characteristics of PLL
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